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教師資料查詢 | 教師：鄭國興

# 學年期 類別 標題
31 90-1 會議論文 Prioritized prime implicant patterns puzzle for novel logic synthesis and optimization
32 88-1 會議論文 A Low-Power CMOS Output Buffer
33 86-1 會議論文 A 1.2V Low-Power TSPC Complementary Pass-Transistor Logic
34 86-1 會議論文 The Charge-Transfer Feedback-Controlled Split-Path CMOS Buffer
35 86-1 會議論文 A 1.2V 32-bit CMOS Adder Design Using Conventional 5V CMOS Process
36 92-1 會議論文 A 14-Bit, 200 MS/S Digital-To-Analog Converter Without Trimming
37 92-1 會議論文 Design of Low-Power Content Addressable Memory Cell
38 91-1 會議論文 MOS Charge Pump for Sub-2.0V Operation
39 91-1 會議論文 Low-Voltage GHz Dynamic Logic Circuit Design
40 84-1 會議論文 Rule Extraction for Isolated Speech Recognition
41 83-1 期刊論文 The asynchronous latched CMOS differential logic(ALCDL) and its application in dasign of high speed parallel multipliers
42 88-1 研究報告 低電壓金氧半電晶體鎖相迴路晶片設計
43 81-1 研究獎勵 (新聘博士學位第一年免附著作)
44 88-1 研究獎勵 Design and analysis of low-voltage current mode operational amplifier with differential – input and differential-output
45 88-1 研究獎勵 The Charge－Transfer Feedback－Controlled Split－Path CMOS Buffer
46 84-1 研究獎勵 新型電流偵測互補式布通電晶體邏輯及其在低電壓低功率之應用
47 90-1 研究報告 低電壓低功率之GHz鎖相迴路電路IP製作及內建測試電路設計
48 88-1 研究報告 低功率互補式金氧半呼叫器中頻鑑頻器晶片設計
49 89-1 研究報告 低功率高輸出驅動力之GHz半數位式鎖相迴路電路之設計與實現
50 87-1 研究報告 高性能混合訊號積體電路與系統之設計與研究-子計畫IV：低電壓低功率數位積體電路設計合成及其應用(III)
51 83-1 會議論文 High-speed biCHOS tristate buffer and carry lookahead adder circuit for Low-voltage operation
52 83-1 會議論文 High-speed BiCHOS domino logic family for low-voltage operation
53 87-1 會議論文 Low-power all digital down connverter for IS-95 forward link demodulation
54 86-1 會議論文 A 1.2 V low-power TSPC complementary pass transistor logic
55 86-1 會議論文 1.2V low-power dynamic complementary-pass-transistor logic
56 84-1 會議論文 低功率電流偵測互補式帶通電晶體邏輯設計及其在低電壓快速乘法器之使用
57 87-1 會議論文 The design and analysis of pass-transistor logic for low power applicaations
58 86-1 會議論文 Low-voltage-swing low-power CMOS buffer
59 87-1 會議論文 An efficient FIR filter design for VLSI implementation
60 87-2 會議論文 A programmagle delay element for low power PLL applications